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[技术讨论] 大家觉得Logic里面的CAE封装画多大合适呢？

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1300811688

13 主题	688 回帖	576 积分

二级逆天

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发表于 2018-11-8 22:46 | 显示全部楼层 |阅读模式

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为了能原理图纸大小合理，大家觉得Logic里的CAE封装画多大呢？电阻电容电感IC等的引脚用多长？2D线画几个栅格等等？

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益达

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二级逆天

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发表于 2018-11-9 11:32 | 显示全部楼层

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tiger5z

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发表于 2018-11-10 15:59 | 显示全部楼层

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jeeson196

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1元学习Allegro(2期)

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发表于 2018-11-11 21:12 | 显示全部楼层

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wangzyx

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PADS-181217初级班

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发表于 2018-11-12 22:21 | 显示全部楼层

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ami

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发表于 2018-11-13 09:03 | 显示全部楼层

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夜空星

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一级逆天

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发表于 2019-10-15 19:30 | 显示全部楼层

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the_lagacy_

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二级逆天

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发表于 2019-10-17 08:44 | 显示全部楼层

同样每次都预估不好

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xiaohehe2

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一级逆天

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发表于 2019-12-12 13:29 | 显示全部楼层

同样每次都预估不好

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向心飞翔

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二级逆天

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发表于 2019-12-18 11:00 | 显示全部楼层

方便A4纸打印就好了

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