薄芯片到晶圆混合键合技术作为高良率半导体集成方案

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混合键合技术基础与面临挑战

混合键合技术在先进半导体封装领域发挥重要作用，通过精密的多步骤工艺实现高密度互连。这项技术首先将芯片放置在基板上，在室温条件下形成范德华力介电层-介电层键合，随后通过后键合退火工艺将这些初始的弱键合转化为坚固的共价键连接。在热处理过程中，嵌入的铜材料在键合界面间扩散，建立起器件间的电气连通性。

芯片到晶圆（D2W）混合键合工艺中的主要挑战集中在水分渗透现象上，这种现象可能严重影响键合完整性。与晶圆到晶圆键合相比，D2W工艺会将更多芯片边界暴露在湿法工艺环境中，并涉及更长的等待时间。在高带宽存储器多层堆叠键合或批量退火工艺中收集晶圆时，这种暴露变得特别严重。当水分在共价键形成前渗透到键合界面时，会与铜键合焊盘发生反应，形成氧化铜，导致电气故障和接触电阻增加[1]。

图1：测试载体示意图，器件芯片混合键合到基板上，可直接在基板晶圆的探针焊盘上进行电气测试。

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材料与工艺开发框架

实验方法采用在300毫米硅晶圆上制作的精心设计的测试载体，包含复杂的双金属层结构。每个金属层在二氧化硅介电层内采用大马士革铜金属化工艺，为可靠的电气互连奠定基础。器件和基板晶圆采用相同的圆形键合焊盘几何形状，间距为10微米，但在关键尺寸上有所不同以优化键合性能。器件晶圆的再分布层和键合焊盘层分别采用4微米和3微米的关键尺寸，而基板晶圆采用更大的6微米和5微米尺寸以确保适当的对准容差。

图2：采用TiN牺牲层的等离子体切割示意图，随后进行背面研磨工艺以制备用于键合的薄芯片。

完整的D2W混合键合Assembly工艺遵循精心控制的序列，旨在保持表面活化并防止污染。该工艺从器件晶圆的等离子体切割开始，将晶圆分离成单个芯片，然后对芯片和基板晶圆进行等离子体活化和去离子水润湿。实际键合在室温下的严格控制大气条件下进行，在键合表面保持活化状态的情况下，在4小时关键时间窗口内实施后键合增强工艺。工艺最后在350°C温度下进行5小时高温退火，完成共价键形成和铜互扩散。

图3：D2W混合键合Assembly工艺示意图。

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等离子体切割技术创新提升良率

等离子体切割在薄D2W混合键合应用中发挥核心技术作用，在精度、清洁度和结构完整性方面相比传统机械切割方法具有显著优势。通过物理气相沉积技术沉积200埃厚度的氮化钛牺牲层，为等离子体蚀刻工艺中的键合表面提供必要保护。这种保护方法采用20微米光刻关键尺寸和70微米干法蚀刻深度，随后通过背面研磨达到最终的50微米芯片厚度。

图4：等离子体切割与机械切割的缺陷比较及对后键合共焦扫描声学显微镜（CSAM）的影响。

牺牲氮化钛层除了表面保护外还具有多种关键功能。没有这种保护层时，介电表面粗糙度会增加超过0.5纳米，由于表面接触不充分导致键合失败。此外，飞行时间二次离子质谱分析显示，未经氮化钛保护处理的表面表现出较高的氟污染水平，表明等离子体诱导的表面损伤会影响键合质量。

图5：后键合退火后的CSAM图像。晶圆上半部分：无TiN保护。晶圆下半部分：有TiN保护。

图6：TOF-SIMS检测键合介电层上的F-离子。

通过优化物理气相沉积氮化钛沉积厚度并精细调节等离子体蚀刻和氮化钛湿法蚀刻工艺，能够将等离子体切割模块造成的铜焊盘凹陷差异控制在2纳米以内。这确保键合前铜凹陷的总体规格限制保持在5纳米以下，从而确保不会影响后续的后键合退火温度。

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薄芯片应用的后键合增强技术

薄芯片应用在机械应力和翘曲方面面临独特挑战，需要专门的缓解策略。50微米厚度的芯片相比标准310微米厚度芯片表现出显著更高的翘曲度，导致明显的边缘分层，影响电气连通性和长期可靠性。

图7：芯片翘曲度测量。左侧：310微米厚芯片。右侧：50微米厚芯片。

后键合增强工艺通过在键合表面保持活化状态下、后键合退火前的精确时机机械处理来解决薄芯片分层问题。这种干预证明非常有效，将电气测试良率从没有增强处理的约25%提升到超过90%，与标准厚度芯片达到的性能相匹配。

图8：50微米厚芯片到晶圆混合键合的CSAM图像。左侧：采用后键合增强。右侧：未采用后键合增强。

图9：10,000条菊花链电气连通性测试结果的累积分布图，包括厚芯片和薄芯片不同处理的对比。

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可靠性验证与性能评估

综合可靠性测试通过严格的老化协议验证了集成等离子体切割和后键合增强方法的有效性。测试结构经历了1级和3级湿度敏感性测试条件，以及在-40°C到125°C之间延展到1000次循环的热循环测试。芯片边缘的开尔文接触电阻测量在这些应力条件下作为水分渗透和界面退化的敏感指标。

图10：可靠性应力测试后的开尔文电阻测量。

通过牺牲层保护的等离子体切割减少颗粒产生，结合后键合增强消除薄芯片引起的分层，在键合界面创造了稳固的"拉链锁"效应。这种集成方法成功防止水分渗透影响内部键合焊盘，为需要高密度互连和优异电气性能的先进封装应用提供了可靠的薄芯片集成解决方案。